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5-Channel Precision Temperature Monitor
with Beta Compensation
_______________________________________________________________________________________   3
ELECTRICAL CHARACTERISTICS (continued)
(V
CC
= +3.0V to +3.6V, V
STBY
= V
CC
, T
A
= -40癈 to +125癈, unless otherwise noted. Typical values are at V
CC
= +3.3V and T
A
=
+25癈.) (Note 2)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
High level, channel 1
500
Low level, channel 1
20
High level, channels 2, 3, 4
80
100
120
Remote-Diode Source Current
I
RJ
Low level, channels 2, 3, 4
8
10
12
礎
Undervoltage-Lockout Threshold
UVLO
Falling edge of V
CC
disables ADC
2.30
2.80
2.95
V
Undervoltage-Lockout Hysteresis
90
mV
Power-On-Reset (POR) Threshold
V
CC
 falling edge
1.2
2.0
2.25
V
POR Threshold Hysteresis
90
mV
ALERT, OVERT
I
SINK
 = 1mA
0.3
Output Low Voltage
V
OL
I
SINK
 = 6mA
0.5
V
Output Leakage Current
1
礎
SMBus INTERFACE (SMBCLK, SMBDATA), STBY
Logic Input Low Voltage
V
IL
0.8
V
Logic Input High Voltage
V
IH
V
CC
 = 3.0V
2.2
V
Input Leakage Current
-1
+1
礎
Output Low Voltage
V
OL
I
SINK
 = 6mA
0.3
V
Input Capacitance
C
IN
5
pF
SMBus-COMPATIBLE TIMING (Figures 3 and 4) (Note 4)
Serial-Clock Frequency
f
SMBCLK
(Note 5)
400
kHz
f
SMBCLK
 = 100kHz
4.7
Bus Free Time Between STOP
and START Condition
t
BUF
f
SMBCLK
 = 400kHz
1.6
祍
f
SMBCLK
 = 100kHz
4.7
START Condition Setup Time
f
SMBCLK
 = 400kHz
0.6
祍
90% of SMBCLK to 90% of SMBDATA,
f
SMBCLK
 = 100kHz
0.6
Repeat START Condition Setup
Time
t
SU:STA
90% of SMBCLK to 90% of SMBDATA,
f
SMBCLK
 = 400kHz
0.6
祍
START Condition Hold Time
t
HD:STA
10% of SMBDATA to 90% of SMBCLK
0.6
祍
90% of SMBCLK to 90% of SMBDATA,
f
SMBCLK
 = 100kHz
4
STOP Condition Setup Time
t
SU:STO
90% of SMBCLK to 90% of SMBDATA,
f
SMBCLK
 = 400kHz
0.6
祍
10% to 10%, f
SMBCLK
 = 100kHz
1.3
Clock Low Period
t
LOW
10% to 10%, f
SMBCLK
 = 400kHz
1.3
祍
Clock High Period
t
HIGH
90% to 90%
0.6
祍
f
SMBCLK
 = 100kHz
300
Data Hold Time
t
HD:DAT
f
SMBCLK
 = 400kHz (Note 6)
900
ns
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